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vivado xdc约束基础知识16:vivado时序约束设置向导中参数配置二(FPGA静态时序分析模型——寄存器到寄存器)

时间:2025-03-14      来源:FPGA_UCY 关于我们 0

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以下内容为STA所需的基本知识,需要反复理解才能吸收,惭愧的是,我已经理解很多次啦, 每一次再看到,都感觉有一点生疏,做流程的同学,可能接触更多,理解更好吧。

1. 适用范围

本文档理论适用于Actel FPGA并且采用软件进行静态时序分析(寄存器到寄存器)。

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