FPGA开发之网表文件制作

0. 前言

FPGA设计流程，所有的代码其最后都是生成一个个的网表文件，这些网表文件就是FPGA最底层的东西，它反映着整个工程的门电路搭建。

作为一名FPGA程序猿，有时候我们不想把自己辛辛苦苦写的代码给到别人，但是又必须把功能模块给到对方，这时候给一个网表文件是最好的选择，这样对方既能够使用我们的模块，有无法看到我们的代码。典型的就是原厂的IP核，人家就只想给你功能，不想给你代码，怕你偷师~~，另一方面也是基于知识产权的保护。

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